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ASIC and FPGA Verification - A Guide to Component Modeling (Cód: 2890452)

Munden,Richard

ELSEVIER S&T

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ASIC and FPGA Verification - A Guide to Component Modeling

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Descrição

Richard Munden demonstrates how to create and use simulation models for verifying ASIC and FPGA designs and board-level designs that use off-the-shelf digital components. Based on the VHDL/VITAL standard, these models include timing constraints and propagation delays that are required for accurate verification of today'apos;s digital designs.

ASIC and FPGA Verification: A Guide to Component Modeling expertly illustrates how ASICs and FPGAs can be verified in the larger context of a board or a system. It is a valuable resource for any designer who simulates multi-chip digital designs.

*Provides numerous models and a clearly defined methodology for performing board-level simulation.
*Covers the details of modeling for verification of both logic and timing.
*First book to collect and teach techniques for using VHDL to model 'quot;off-the-shelf'quot; or 'quot;IP'quot; digital components for use in FPGA and board-level design verification.

Características

Peso 0.00 Kg
Produto sob encomenda Sim
Marca ELSEVIER S&T
Número de Páginas 336 (aproximado)
Idioma 337
Acabamento e-book
Territorialidade Internacional
Formato Livro Digital Pdf
Gratuito Não
Proteção Drm Sim
Tamanho do Arquivo 1455
Início da Venda 23/10/2004
Código do Formato Pdf
Cód. Barras 9780080475929
Ano da edição 92004
Ano da Publicação 2004
AutorMunden,Richard